價(jià) 格：面議

產(chǎn)品概述

與LabVIEW無(wú)縫連接，泰科提供圖形化API函數(shù)。技數(shù)據(jù)采集是泰科一種基于PXIe總線的數(shù)字化儀。該板卡提供4路單端模擬量輸入，技數(shù)據(jù)采集12位ADC采樣精度，泰科轉(zhuǎn)換速率高達(dá)40MS/s（PXIe8502）/80MS/s（PXIe8512）。技數(shù)據(jù)采集

產(chǎn)品參數(shù)

AD模擬量輸入

ADC分辨率

12位（Bit）

輸入通道

4路單端

輸入量程

±5V、泰科±1V

采樣率

高達(dá)40MS/s（PXIe8502）/80MS/s（PXIe8512）

采樣方式

同步采樣

存儲(chǔ)器深度板載2GB內(nèi)存

校準(zhǔn)方式

軟件自動(dòng)校準(zhǔn)

耦合方式

直流耦合、技數(shù)據(jù)采集交流耦合

觸發(fā)源

軟件觸發(fā)、泰科ATR觸發(fā)、技數(shù)據(jù)采集DTR觸發(fā)、泰科Trigger

信號(hào)觸發(fā)（用于多卡同步）

ATR輸入源

從AI0~AI3的技數(shù)據(jù)采集任一通道輸入

觸發(fā)源輸入范圍

ATR輸入范圍

同AD量程

DTR輸入范圍

標(biāo)準(zhǔn)TTL電平

輸入阻抗

1MΩ（50Ω可定制）

帶寬

20MHz（PXIe8502）/40MHz（PXIe8512）

時(shí)鐘源

板載時(shí)鐘、外部10M、泰科PXICLK_10M、技數(shù)據(jù)采集PXIECLK_100M、泰科外時(shí)鐘

外時(shí)鐘輸入范圍

PXIe8502：10MHz~40MHz，幅值為2Vpp~5Vpp

PXIe8512：10MHz~80MHz，幅值為2Vpp~5Vpp

數(shù)據(jù)存儲(chǔ)

可搭配PXIe-SSDM2X存儲(chǔ)模塊實(shí)現(xiàn)高達(dá)640MB/s實(shí)時(shí)數(shù)據(jù)流盤

聯(lián)系方式：15726604412、15910369641 微信同號(hào)

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